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UC3879不能移相，外部同步時鐘給定的問題

1.四路脈沖都可以輸出，但不能移相（調(diào)節(jié)comp端電阻和Uin，且采用內(nèi)部同步時鐘時移相角均沒有變化）、

求助各位大蝦，為何不能移相？？！！謝謝?。?！

PS:CS端斷開，這兒有問題，不知這有沒有問題；

2.我用DSP芯片給3879提供占空比為50%的方波作為外部同步時鐘時，輸出十分混亂！占空比在5%左右時變正常了，為何？

謝謝??！


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kfzyly
LV.4
2
2013-09-09 11:06

我也用過同步輸入，不太理想。不知你現(xiàn)在解決沒有。

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hwlofscut
LV.1
3
2013-11-28 15:17
@kfzyly
我也用過同步輸入，不太理想。不知你現(xiàn)在解決沒有。
解決了，呵呵，用CPLD解決的
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kfzyly
LV.4
4
2013-11-28 16:19
@hwlofscut
解決了，呵呵，用CPLD解決的

能稍微介紹一下嗎？

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hwlofscut
LV.1
5
2013-12-01 10:55
@kfzyly
能稍微介紹一下嗎？
因為我的頻率周期分辨率要求很高，采用DDS+CPLD解決了。
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kfzyly
LV.4
6
2013-12-02 06:40
@hwlofscut
因為我的頻率周期分辨率要求很高，采用DDS+CPLD解決了。
同步的信號的電平、脈寬有什么要求呀？我實驗是用的信號發(fā)生器，電平與脈寬都調(diào)了，怎么試都不行，能跟我介紹一下嗎？謝謝！
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hwlofscut
LV.1
7
2013-12-10 11:11
@kfzyly
同步的信號的電平、脈寬有什么要求呀？我實驗是用的信號發(fā)生器，電平與脈寬都調(diào)了，怎么試都不行，能跟我介紹一下嗎？謝謝！
看數(shù)據(jù)手冊啊，都有寫。正脈寬400ns~600ns，電平cmos、TTL都可以的。
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kfzyly
LV.4
8
2013-12-11 21:13
@hwlofscut
看數(shù)據(jù)手冊啊，都有寫。正脈寬400ns~600ns，電平cmos、TTL都可以的。

我用信號發(fā)生器發(fā)生器輸出的信號，作為同步信號，為什么不行呢？

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hwlofscut
LV.1
9
2014-01-03 21:50
@kfzyly
我用信號發(fā)生器發(fā)生器輸出的信號，作為同步信號，為什么不行呢？
正脈寬寬度滿足要求？是否有驅(qū)動電阻接地？如果這些都滿足要求是不可能沒有輸出的
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